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你好,可否講解一下這樣測試的原理?我覺得萬用表測試出來的數據應該不會是PK_PK值的吧.

加擱置電容應該是讓變壓器輸出產生一個交流波形,出現一個負電電壓,這樣,mos關段的效果更好.不知道我說的對不對.還有你的變壓器變比是按照多少來設計的,提高變比可以提高輸出電壓.用環(huán)形磁芯做驅動變壓器可以將漏感減少下來.

兩種芯片的最大占空比限制不一樣.3844最大占空比不能超過0.5

估計你的變壓器工藝有問題,漏感太大了,就會引起上沖下沖