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【圖】請高手幫忙看一下這個BUCK關斷時的波形

BUCK電路,目前還是初步調(diào)試階段,MOSFET關斷時的Vgs,Vds,Id分別如下圖中的CH1,CH2,CH3所示。從波形上看,似乎是MOSFET在應該關斷的時候誤導通了,所以電流又從0開始上升,后面部分Vds有一個電壓跌落,Id看上去就是正弦振蕩。。。圖沒有截好,這一部分看不到。之后,Vds和Vgs又恢復正常。求教一下各位大俠,這會是什么原因造成的呢?謝謝!

   

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2011-09-21 08:07

上電路圖看看

之后又恢復正常?這"之后"是什么意思?那你有問題的波形又是什么時候產(chǎn)生的?剛開機時?

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2011-09-21 13:49
@edie87@163.com
上電路圖看看之后又恢復正常?這"之后"是什么意思?那你有問題的波形又是什么時候產(chǎn)生的?剛開機時?

終于有人回應了,非常感謝。


這個是進入穩(wěn)態(tài)之后的波形,“之后”是指Vds電壓跌落之后(仍在關斷的時期之內(nèi))會再恢復到正常值。之后每個開關周期都會如此(關斷時期電流大幅度震蕩,電壓跌落)。


開始我想是驅(qū)動的問題,檢查了一半天,驅(qū)動信號Vgs沒有問題,現(xiàn)在仍在探查之中……

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dolameng
LV.4
4
2011-09-21 14:33
@luckycharm
終于有人回應了,非常感謝。這個是進入穩(wěn)態(tài)之后的波形,“之后”是指Vds電壓跌落之后(仍在關斷的時期之內(nèi))會再恢復到正常值。之后每個開關周期都會如此(關斷時期電流大幅度震蕩,電壓跌落)。開始我想是驅(qū)動的問題,檢查了一半天,驅(qū)動信號Vgs沒有問題,現(xiàn)在仍在探查之中……

能否貼出后面的波形。

另外,實際電路用的時NMOS還是PMOS?應該是PMOS吧,否則漏極怎么可能會在Vgs為0時還會這么大。

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2011-09-21 14:46
@dolameng
能否貼出后面的波形。另外,實際電路用的時NMOS還是PMOS?應該是PMOS吧,否則漏極怎么可能會在Vgs為0時還會這么大。

好的,稍后會貼出一個周期的波形。

實際電路用的是NMOS,關斷的時候Vds上升到輸入電壓的值,是對的吧?

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2011-09-22 08:46
@luckycharm
好的,稍后會貼出一個周期的波形。實際電路用的是NMOS,關斷的時候Vds上升到輸入電壓的值,是對的吧?
問題已經(jīng)找到,Vgs是用10X的探頭測的,Vds是用差分探頭測的,大概前者性能不好或者耦合進了一些干擾,去掉前一個探頭,換成差分的就好了。
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dolameng
LV.4
7
2011-09-22 13:14
@luckycharm
問題已經(jīng)找到,Vgs是用10X的探頭測的,Vds是用差分探頭測的,大概前者性能不好或者耦合進了一些干擾,去掉前一個探頭,換成差分的就好了。
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2011-09-23 13:08
@dolameng
[圖片]

這是怎么了。。。

只是一個buck而已,的確不應該出現(xiàn)什么難倒人的大錯誤,我是菜鳥,還需要多學習。。。

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